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我尝试了IP内核中的Math Functions--dividers， 里面有2个IP核，我都试过了，仿真的时候输出总是高阻状态。
我使用的是Xilinx V2PRO， ISE10.1， Verilog语言，采用自带的ISE Simulator仿真器
仿真的时候出现下面这行提示，并且仿真结果也一直处于高阻状态，求求各位大侠帮我解决，真的很着急......
HDLCompiler:559 - "divider.v" Line 60. Instantiating unknown module DIV_GEN_V1_0 |
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发表于 2012-5-24 16:01:24