FPGA/CPLD文章列表

CMOS摄像头接口时序设计1理想时序（特权同学版权所有）本文节选自特权同学的图书《FPGA设计实战演练（逻辑篇）》（特权同学版权所有）配套例程下载链接：http://pan.baidu.com/s/1pJ5bCtt 本实 ...

VGA驱动接口时序设计之7优化本文节选自特权同学的图书《FPGA设计实战演练（逻辑篇）》配套例程下载链接：http://pan.baidu.com/s/1pJ5bCtt 最后，再次编译系统，查看时序报告。如图8.41和图8.42 ...

VGA驱动接口时序设计之6建立和保持时间约束本文节选自特权同学的图书《FPGA设计实战演练（逻辑篇）》配套例程下载链接：http://pan.baidu.com/s/1pJ5bCtt 接着，我们可以对VGA的信号做如下的约 ...

我在想，如果当初有人给我指导一下FPGA之路怎么走那该有多好啊！为了不想大家再走我经过的弯道，所以以自己的真实经历为鉴！ 更多学习与交流请加QQ群：单片机交流群 372831027 如何学习FPGA, ...

VGA驱动接口时序设计之5建立和保持时间计算本文节选自特权同学的图书《FPGA设计实战演练（逻辑篇）》配套例程下载链接：http://pan.baidu.com/s/1pJ5bCtt 在我们的应用中，仿照官方的 ...

Synplify 和 Synplify Pro 是 Synplicity 公司提供的专门针对FPGA和CPLD实现的逻辑综合工具它支持VHDL93 IEEE1076 , 包括std_logic_1164 Numeric_std std_logic_Usigned std_logic_Signed std_l ...

VGA驱动接口时序设计之4建立和保持时间分析本文节选自特权同学的图书《FPGA设计实战演练（逻辑篇）》配套例程下载链接：http://pan.baidu.com/s/1pJ5bCtt 下面我们可以简单的来分析一下数据的建 ...

长期以来很多新入群的菜鸟们总 是在重复的问一些非常简单但是又让新手困惑不解的问题。作为管理员经常要给这些菜鸟们普及基础知识，但是非常不幸的是很多菜鸟怀着一种浮躁的心态来学习 FPGA，总 ...

我认为有些人的观点错了。错得一塌糊涂。  对于这个问题，我的基本观点是：任何实践都是理论的载体或表现形式。而理论也是由实践上升而来的。两者是辨证的。今天，我们只关注它的前一部分 ...

VGA驱动接口时序设计之3时钟约束本文节选自特权同学的图书《FPGA设计实战演练（逻辑篇）》配套例程下载链接：http://pan.baidu.com/s/1pJ5bCtt 如图8.26所示，FPGA产生的数据data_out和时钟clk_ ...

VGA驱动接口时序设计之2源同步接口本文节选自特权同学的图书《FPGA设计实战演练（逻辑篇）》配套例程下载链接：http://pan.baidu.com/s/1pJ5bCtt 好，有了这些信息，我们可以分析一下这个接口的 ...

VGA驱动接口时序设计之1概述本文节选自特权同学的图书《FPGA设计实战演练（逻辑篇）》配套例程下载链接：http://pan.baidu.com/s/1pJ5bCtt 第六章第8节中我们给出了VGA/SVGA显示驱动设计的实例 ...