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[提问] verilog中寄存器大小 [复制链接]

codefpga (离线)
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发表于 2017-11-17 09:32:42 |显示全部楼层
关键词: reg
请问verilog中定义reg寄存器类型,有最大位宽限制吗?
ddxx (离线)
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发表于 7 天前 |显示全部楼层
宽度是自己定义的,没有限制
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