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[提问] verilog中寄存器大小

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codefpga
发表于 2017-11-17 09:32:42 | 显示全部楼层 |阅读模式
白皮书下载：测量系统构建完整指南
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关键词： reg
请问verilog中定义reg寄存器类型，有最大位宽限制吗？

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ddxx
发表于 2018-10-11 14:53:02 | 显示全部楼层
宽度是自己定义的，没有限制
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