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[提问] 关于FPGA开发软件编译时对于警告的处理

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发表于 2011-3-24 15:49:05 | 显示全部楼层 |阅读模式
大家共同讨论下在使用诸如QUARTUS之类开发程序时出现警告时怎么处理,对综合后的线路有什么影响
发表于 2011-3-24 16:26:49 | 显示全部楼层
是提问吧?
发表于 2011-3-25 22:20:18 | 显示全部楼层
?
发表于 2011-4-9 14:10:10 | 显示全部楼层
对于风格性的警告,如果自己有把握,一般可以不考虑。。。
发表于 2011-4-15 10:50:48 | 显示全部楼层
。。。
发表于 2011-4-21 22:00:06 | 显示全部楼层
一般警告不用在意,基本上不影响调试
发表于 2011-4-23 08:04:54 | 显示全部楼层
一般没有什么致命的,不过最好还是看看,对编程有帮助
发表于 2011-4-23 23:18:51 | 显示全部楼层
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发表于 2011-10-13 20:17:29 | 显示全部楼层
最好还是看一下这些警告是如何来产生的,如果是一些不确定的变量引起的,劝你尽量赋值将其确定
发表于 2011-11-2 14:38:05 | 显示全部楼层
具体情况具体分析
发表于 2011-11-17 16:29:18 | 显示全部楼层
警告一般不影响综合的结果
发表于 2011-12-20 15:47:40 | 显示全部楼层
可以仔细看下warning info,上面有提示的,看看端口什么的是不是连接正确
发表于 2011-12-20 16:36:37 | 显示全部楼层
很多警告都是没有关系的,但可以关注一下警告的总数,在警告增加的情况下,可以协助你检查一些低级错误!
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