泰克推出用于串行数据链路分析的新工具集
发布时间：2013-2-19 10:06
发布者：eechina
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为深入分析高速串行与DDR内存总线提供综合、灵活、易于操作的框架结构 泰克公司日前宣布，推出与其高性能示波器（包括DPO/DSA/MSO70000系列）结合使用的新SDLA Visualizer（串行数据链路分析观察仪）软件包。需要满足下一代高速串行标准要求的设计人员可使用SDLA Visualizer来详细说明其链路特征、对测量路径上的任何元件进行反嵌入 (de-embed)、仿真虚拟链路元件、运用均衡器以及在串行数据系统、模块或芯片组中的发射接收线路上的多个点进行测量。 需要对计算机、通信以及高速内存总线进行物理层检测、调试和一致性验证的设计人员，SDLA Visualizer可帮助他们可靠地消除模拟行为与实际信号完整性性能之间的差距。这进而又会显著缩短设计周期和加快关键设计项目的决策速度。 “随着串行数据与内存标准变得越来越快和更加复杂，设计人员需要新的更强大和灵活的工具来准确地检测被测信号”，泰克公司高性能示波器总经理Brian Reich表示，“借助SDLA Visualizer，客户不仅能够通过先进的模拟功能来验证与串行标准的一致性，还能实现在检测、一致性验证与调试环境之间的无缝转换。” 从USB 3.0开始，最新串行技术需要的是能够覆盖网络、测量设备以及硅专属IP模型的所有元件的先进链路分析软件。同样，那些需要在系统中实现更快链路的嵌入式设计人员面临着在期望的测试点进行信号探测，以及必须去除反射和其他效应，以便能够看到真实信号的各种挑战。 为满足这些要求，SDLA Visualizer提供了完整的4端口模拟功能，并考虑到了发射器输出阻抗、示波器和接收器输入阻抗以及通道和夹具阻抗，以及接收端均衡器設置，来提供潜在信号的最真实表示。这是通过提供关于链路中每个元件的反射、插入损耗和交互耦合项信息来实现的。它还让用户能够按照需要来验证和调试单个链路元件的S参数，从而为用户节省时间和逐元件提供在链路中任何测试点的可视性。 另一个关键挑战是验证链路模型。SDLA通过提供一组完整的图表（包括频率响应、相响应以及所有16个S参数的图表）使得这项任务更易于完成。在可用性之外，SLDA还提供了单一公共用户界面来定义所有链路元件，同时让用户能够灵活地定义测试点，而无需为每个测试点建立一个不同的链路模型。SDLA Visualizer与DPOJET抖动和眼图分析软件相结合允许用户同时验证多个测试点的眼图与抖动结果，从而确信模型配置的正确性。 IBIS AMI模型集成 为了使有关硅专属IP模型的处理更容易，SDLA Visualizer在支持参考接收器均衡技术之外还能结合厂商专属接收器均衡与时钟恢复算法来帮助配置和定义链路模型。这些模型常常基于关于串行物理层 (PHY) 链路的IBIS算法建模接口 (IBIS-AMI) 建模标准。 “系统设计人员在PCB前使用IBIS-AMI模型来设计和验证高速链路，模型准确度是一大问题”，用于系统级高速设计的EDA仿真软件领先提供商SiSoft公司首席执行官Barry Katz表示，“客户需要简单明了的方法来关联模型与测量，并在实验室硬件上执行实时what-if分析。通过这款新SDLA框架，泰克公司为信号完整性实验室功能奠定了基础，而这种集成度在实验室功能方面是非常寻常的事情。” 供货信息 新SDLA Visualizer软件将于2013年第一季度末推出，届时全球客户即可进行下载。详细信息请联系您的泰克客户经理。 |
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