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当配置RPD (CONFIG0.2) 为0,P2.0被配置为输入引脚。同时P2.0将永远在输入模式和施密特触发模式,通过P20UP(P2S.7)使能内部上拉电阻。如果RPD未编程,P2.0作为外部复位引脚,P2.0作为管脚功能无效,由于作为复位脚,内部上拉电阻始终有效,此种状态下读取P2.0的值始终为0.
准双向模式
准双向模式作为标准8051的I/O结构,可以同时用作输入和输出。当端口输出逻辑高时,驱动能力较弱,同时允许外部器件将电平拉低。当引脚被拉低时有强驱动能力,会吸收大电流。在准双向I/O 结构中,有三个上拉MOS管,适应不同的应用。其中一个上拉叫做特弱上拉,当端口锁定在逻辑1时,打开特弱上拉,特弱上拉有很小电流将引脚拉高。
第二种上拉为“弱上拉”,当外部端口引脚自身处于逻辑1时打开。这种上拉提供源电流以使准双向引脚输出1。如果引脚为逻辑1,被外部器件拉低, “弱上拉”关闭, 仅有“特弱上拉”打开。 此时要将引脚拉低,外部器件要有足够的灌电流 (大于ITL)以克服“弱上拉”,并使端口的电压低于输入门限电压 (低于VIL)。
第三种上拉为“强上拉”。这种上拉用于在准双向口引脚上,加速端口电平由逻辑0转为逻辑1的转换速度。 当这种
情况发生时,打开强上拉用两个CPU时钟的时间快速地将端口引脚拉高。 然后就关闭,弱上拉和特弱上拉继续
保持该端口引脚为高。 准双向端口结构如下所示。
推挽模式
推挽输出模式与准双向输出模式有相同的下拉结构。当端口锁定为1时,提供持续的强上拉。推挽输出模式用于需要从端口输出大电流时的应用。
输入模式提供真实的高阻输入路径。虽然准双向模式也可以作为输入引脚,但是它需要相对强的输入源。输入模式的好处是减少在逻辑0时电流的消耗,如果是准双向模式,逻辑0时总是消耗来自VDD 的电流。用户需要注意的是,输入模式应该由外部设备或电阻提供一个确定的电平。悬浮的引脚在掉电状态下会引起漏电。
开漏模式
开漏输出配置关闭所有内部上拉,当端口锁定为逻辑0时,仅打开驱动端口的下拉晶体管。当端口锁存为逻辑1
时,它就和输入模式一样。通常用于I2C输出线上,开漏引脚需要加一个外部上拉电阻,典型连一个电阻到
VDD。 用户需要注意的是,开漏模式输出逻辑1的时候,应该由外部设备或电阻提供一个确定的电平。悬浮的引
脚在掉电状态下会引起漏电。
读-修改-写 指令
从SFR或内部RAM读一个字节,修改它,并重新写回去的指令,叫做读-修改-写指令。当目标是一个I/O端口或
一个端口位,这些指令读内部输出锁存而不是外部引脚的状态,这种指令读端口SFR的值,修改它并写回到SFR
端口。所有读-修改-写的指令如下所列:
指令 描述
ANL 逻辑 与. (ANL direct, A and ANL direct, #data)
ORL 逻辑 或. (ORL direct, A and ORL direct, #data)
XRL 逻辑 异或 OR. (XRL direct, A and XRL direct, #data)
JBC if bit = 1 转跳指令并清除. (JBC bit, rel)
CPL 位取反. (CPL bit)
INC 加一指令. (INC direct)
DEC 减一指令. (DEC direct)
DJNZ 减一不为零转跳指令. (DJNZ direct, rel)
MOV bit, C 移进位标志到位. (MOV bit, C)
CLR bit 清位. (CLR bit)
SETB bit 置位. (SETB bit)
最后三条指令看似不是明显的读-修改-写指令,实际它们就是读-修改-写指令。 可以读整个端口锁定值,修改改变位,写入新的值。
管脚控制寄存器
N76E003有许多I/O控制寄存器提供灵活的各种应用。和I/O端口相关的SFRs可以分类成四组:输入输出控制,输出模式控制、输入类型和灌电流控制,输出斜率控制。所有SFRs如下所列:
输入输出数据控制
这些寄存器是I/O输入输出数据缓存。读获取I/O输入的数据。写驱动数据输出,所有这些寄存器都是可位寻址的。
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